DM9000A中文手册完整版

2022-08-16 来源：易榕旅网

南京电研电力自动化股份有限公司 http://www.naco.com.cn

DAVICOM Semiconductor, Inc.

DM9000A

Ethernet Controller

with General Processor Interface

DATA SHEET

（中文数据手册）

Preliminary

Version: DM9000A-DS-P03

Apr. 21, 2005

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1. 概述 .......................................................................................................................... 5 2. 模块图 ...................................................................................................................... 5 3. 特性 .......................................................................................................................... 5 4. 引脚配置 .................................................................................................................. 6

4.1（16位模式） ..................................................................................................................... 6 4.2（8位模式） ....................................................................................................................... 7

5. 引脚描述 .................................................................................................................. 7

5.1处理器接口 ......................................................................................................................... 7

5.1.1 8位模式引脚 ........................................................................................................... 8 5.2 EEPROM接口 ................................................................................................................... 8 5.3时钟引脚 ............................................................................................................................. 9 5.4 LED接口 ............................................................................................................................ 9 5.5 10/100 PHY/Fiber ............................................................................................................... 9 5.6其他 ................................................................................................................................... 10 5.7电源引脚 ........................................................................................................................... 10 5.8捆绑引脚列表（Strap pins table） .................................................................................. 10

6. 控制和状态寄存器列表 ........................................................................................ 10

6.1网络控制寄存器（NCR） ............................................................................................... 12 6.2网络状态寄存器（NSR） ............................................................................................... 13 6.3发送控制寄存器（TCR） ............................................................................................... 13 6.4数据包1发送状态寄存器1（TSR I） .......................................................................... 13 6.5数据包2发送状态寄存器2（TSR II） ......................................................................... 14 6.6接收控制寄存器（RCR） ............................................................................................... 14 6.7接收状态寄存器（RSR） ............................................................................................... 15 6.8接收溢出计数寄存器（ROCR） .................................................................................... 15 6.9背压阈值寄存器（BPTR） ............................................................................................. 15 6.10流控制阈值寄存器（FCTR） ....................................................................................... 16 6.11接收/发送流控制寄存器（RTFCR） ........................................................................... 16 6.12 EEPROM与PHY控制寄存器（EPCR） .................................................................... 17 6.13 EEPROM与PHY地址寄存器（EPAR） .................................................................... 17 6.14 EEPROM与PHY数据寄存器（EPDRL/EPDRH） ................................................... 18 6.15唤醒控制寄存器（WCR） ............................................................................................ 18 6.16物理地址（MAC）寄存器（PAR） ............................................................................ 18 6.17多播地址寄存器（MAR） ............................................................................................ 19 6.18通用目的控制寄存器（GPCR） .................................................................................. 19 6.19通用目的寄存器（GPR） ............................................................................................. 19 6.20 TX SRAM读指针地址寄存器（TRPAL/TRPAH） .................................................... 20 6.21 RX SRAM写指针地址寄存器（RWPAL/RWPAH） .................................................. 20 6.22厂家ID寄存器（VID） ............................................................................................... 20 6.23产品ID寄存器（PID） ................................................................................................ 20 6.24芯片版本寄存器（CHIPR） ......................................................................................... 20 6.25发送控制寄存器2（TCR2） ........................................................................................ 20

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6.26操作测试控制寄存器（OCR） ..................................................................................... 21 6.27特殊模式控制寄存器（SMCR） .................................................................................. 21 6.28即将发送控制/状态寄存器（ETXCSR） .................................................................... 22 6.29校验和控制寄存器（TCSCR） .................................................................................... 22 6.30接收校验和控制状态寄存器（RCSCSR） .................................................................. 22 6.31内存数据预取读命令寄存器（地址不加1）(MRCMDX) ......................................... 23 6.32内存数据读命令寄存器（地址不加1）(MRCMDX1) ............................................... 23 6.33内存数据读命令寄存器（地址加1）(MRCMD) ........................................................ 23 6.34内存数据读地址寄存器（MRRL/ MRRH） ................................................................ 23 6.35内存数据写命令寄存器（地址不加1）(MWCMDX) ................................................ 23 6.36内存数据写命令寄存器（地址加1）(MWCMD) ....................................................... 24 6.37内存数据写地址寄存器（MWRL/ MWRH）.............................................................. 24 6.38发送数据包长度寄存器（TXPLL/TXPLH）............................................................... 24 6.39中断状态寄存器（ISR） ............................................................................................. 24 6.40中断屏蔽寄存器（IMR） ............................................................................................. 24

7．EEPROM格式 ..................................................................................................... 25 8．PHY寄存器描述 .................................................................................................. 26

8.1基本模式控制寄存器（BMCR） ................................................................................... 27 8.2基本模式状态寄存器（BMSR） .................................................................................... 28 8.3 PHY ID标识符寄存器#1（PHYID1） ........................................................................... 29 8.4 PHY ID标识符寄存器#2（PHYID1） ........................................................................... 29 8.5自动协商通知寄存器（ANAR） .................................................................................... 30 8.6自动协商连接对象寄存器（ANLPAR） ....................................................................... 31 8.7自动协商扩展寄存器（ANER） .................................................................................... 32 8.8 DAVICOM指定配置寄存器（DSCR） ......................................................................... 33 8.9 DAVICOM指定配置和状态寄存器（DSCSR） ........................................................... 34 8.10 10BASE-T配置/状态（10BTCSR） ............................................................................ 36 8.11掉电控制寄存器（PWDOR） ....................................................................................... 36 8.12指定配置寄存器（SCR） ............................................................................................. 37

9. 功能描述 ................................................................................................................ 38

9.1 主机接口（HI） ............................................................................................................. 38 9.2 直接内存访问控制（DMAC） ...................................................................................... 38 9.3 数据包发送（PT） ......................................................................................................... 38 9.4 数据包接收（PR） ......................................................................................................... 38 9.5 100Base-TX操作 ............................................................................................................. 39

9.5.1 4B5B编码器 ......................................................................................................... 39 9.5.2扰频器（Scrambler） ........................................................................................... 39 9.5.3 并--串转换 ............................................................................................................ 39 9.5.4 NRZ码到NRZI码转换 ....................................................................................... 39 9.5.5 NRZI码到MLT-3码转换 .................................................................................... 39 9.5.6 MLT-3驱动 ............................................................................................................ 39 9.5.7 4B5B编码 ............................................................................................................. 40 9.6 100Base-TX接收器 ......................................................................................................... 40

9.6.1 信号检测 ............................................................................................................... 41

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9.6.2 自适应补偿 ........................................................................................................... 41 9.6.3 MLT-3到NRZI解码 ............................................................................................ 41 9.6.4 时钟复原模块 ....................................................................................................... 41 9.6.5 NRZI 到NRZ ....................................................................................................... 41 9.6.6 串－并转换 ........................................................................................................... 41 9.6.7 扰频器 ................................................................................................................... 41 9.6.8 编码组对齐模块 ................................................................................................... 41 9.6.9 4B5B解码 ............................................................................................................. 42 9.7 10Base-T操作 .................................................................................................................. 42 9.8 冲突检测 .......................................................................................................................... 42 9.9 载波检测 .......................................................................................................................... 42 9.10 自动协商 ........................................................................................................................ 42 9.11 省电模式 ........................................................................................................................ 42

9.11.1 掉电模式 ............................................................................................................. 43 9.11.2 降低发送损耗模式 ............................................................................................. 43

10 DC与AC电器特性 .............................................................................................. 43

10.1 最大绝对额定值 ............................................................................................................ 43

10.1.1 工作条件 ............................................................................................................. 43 10.2 DC电器特性（VDD=3.3V） ....................................................................................... 44 10.3 AC电器特性与时序 ...................................................................................................... 44

10.3.1 TP接口 ................................................................................................................ 44 10.3.2 晶振/振荡时钟 .................................................................................................... 44 10.3.3 I/O读时序 ........................................................................................................... 45 10.3.4 I/O写时序 ........................................................................................................... 45 10.3.5 EEPROM接口时序 ............................................................................................. 46

11应用说明 ................................................................................................................. 46

11.1网络接口信号接线 ......................................................................................................... 46 11.2 10Base-T/100Base-TX自动MDIX应用 ...................................................................... 47 11.3 10Base-T/100Base-TX无自动MDIX变压器应用 ...................................................... 47 11.4电源退偶电容 ................................................................................................................. 47 11.5地平面布局 ..................................................................................................................... 48 11.6电源平面分割 ................................................................................................................. 49 11.7铁氧体磁珠选择指导 ..................................................................................................... 50 11.8晶振选择指导 ................................................................................................................. 50

12封装信息 ................................................................................................................ 50 13订购信息 ................................................................................................................ 52

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DM9000A

翻译人：许建华、刘煜、程志成 2009-9-1 版权：翻译版权归作者三方所有，不得随意传播。

1. 概述

DM9000A是一款完全集成的、性价比高、引脚数少、带有通用处理器接口的单芯片快速以太网控制器。一个10/100M PHY和4K 双字的SRAM 。它是出于低功耗和高性能目的设计的，其IO端口支持3.3V与5V容限值。

DM9000A为适应各种处理器，提供了8位、16位数据接口访问内部存储器。DM9000A物理协议层接口完全支持使用10MBps下3类、4类、5类非屏蔽双绞线和100MBps下5类非屏蔽双绞线。这是完全遵照IEEE 802.3u标准。它的自动协商功能将自动完成DM9000A配置以使其发挥出最佳性能。它还支持IEEE 802.3x全双工流量控制。

2. 模块图

3. 特性

■ 48脚 LQFP封装

■ 支持处理器接口：I/O口的字节或字命令对内部存储器进行读写操作 ■ 集成自适应（AUTO-MDIX）10/100M收发器

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■ 半双工模式流量控制的背压模式 ■ IEEE802.3x全双工模式的流量控制 ■ 支持唤醒帧，链路状态改变和远程唤醒 ■ 内置16K 字节SRAM

■ 内置3.3V至2.5V的调节器 ■ 支持即将发送

■ 支持IP/TCP/UDP的校验和生成以及校验

■ 支持自动加载EEPROM里面生产商ID和产品ID ■ 可选EEPROM配置 ■ 超低功耗模式

A. 功率降低模式（电缆侦测） B. 掉电模式

C. 可选择1：1或1.25：1变压比例降低额外功率 ■ 兼容3.3v和5.0v输入输出电压

4. 引脚配置

4.1（16位模式）

注意：16位的模式和8位模式的引脚对应内容并不一样

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4.2（8位模式）

5. 引脚描述

I = 输入， O = 输出， I/O = 输入/输出， O/D = 漏极开路， P = 电源， # =理论低电平， PD=内置60K下拉电阻

5.1处理器接口

引脚号名称类型处理器读命令；描述 35 IOR# I,PD 低电平有效，极性能够被EEPROM修改，详细请参考对EEPROM内容的描述。处理器写命令； 36 IOW# I,PD 低电平有效，极性能够被EEPROM修改，详细请参考对EEPROM内容的描述。片选； 37 CS# I,PD 低电平有效，来选中DM9000A 。极性能够被EEPROM修改，详细请参考对EEPROM内容的描述。 32 34 CMD INT I,PD O,PD 命令类型；高电平是访问数据端口，低电平是访问地址端口。中断请求信号；高电平有效，极性能修改通过EEPROM或者EECK引脚7

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来修改，详细请参考对EEPROM内容的描述 18,17,16,1 4,13,12,11 ,10 31,29,28,2 7,26,25,24 ,22 SD0~7 I,O,PD 处理器数据总线0~7；处理器数据总线8~15； SD8~15 I,O,PD 在16位模式下，这些引脚被作为数据位8~15。当EECS引脚被上拉时，这些引脚另作它用，详细请参考对8位模式引脚的描述。 5.1.1 8位模式引脚

引脚号 22 名称 WAKE (SD15) 类型 O,PD 描述当唤醒事件发生时，输出一个唤醒信号。全双工 LED；在LED模式1，它低电平输出代表内部PHY工作在全双工24 LED3 (SD14) O,PD 模式，悬空表示内部PHY工作在半双工模式。在LED模式0，它低电平输出代表内部PHY工作在10M模式，悬空表示内部PHY工作在100M模式。注意：LED模式在EEPROM中设置通用输出引脚；这些引脚可在寄存器GPR（1FH）中设置用于通用目的输25，26，GP6,GP5,GP4 27 (SD13~SD11) O,PD 出引脚。这些引脚默认为输出。 GP6引脚也可作为INT输出类型的捆绑引脚；当GP6被置高，INT作为开漏输出类型，否则作为强制输出类型。 28，29，GP3,GP2,GP1 31 (SD10~SD8) 通用 I/O引脚； I/O 寄存器 GPCR 和GPR 可以来编程这些引脚，这些引脚默认为输入。 5.2 EEPROM接口

引脚号 19 20 名称 EEDIO EECK 类型 I/O,PD O,PD 描述 EEPROM 数据输入、输出引脚。 EEPROM时钟信号；该引脚也被用于中断极性的设置。当这个引脚为上拉高电平时，中断低有效，否则中断引脚高有效。 EEPROM 片选信号； 21 EECS O,PD 该引脚也被用于设置内部存储器数据总线宽度。当引脚为上拉高电平时，总线为8位，否则为16位。 8

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5.3时钟引脚

引脚号 43 44 名称 X2 X1 类型 O I 25M晶振输出 25M晶振输入描述 5.4 LED接口

引脚号名称类型速度LED；低电平输出表示内部PHY工作于100M/s的速率下，悬空描述 39 LED1 O 表示内部PHY工作于10M/s的速率下。该引脚可以在16位模式下作为ISA总线IO16（在EEPROM里设置）连接/运行LED；在LED模式1，它作为PHY链路通断和载波侦测的公用灯 38 LED2 O 在LED模式0，它作为PHY载波侦测的专用灯该引脚可以在16位模式下作为ISA IOWAIT 或者 WAKE（在EEPROM里设置） 5.5 10/100 PHY/Fiber

引脚号 46 48 1 2 9 3 4 5，47 6 7 8

名称 SD BGGND BGRES RXVDD25 TXVDD25 RXI+ RXI- RXGND TXGND TX+ TX- 类型 I P I/O P P I/O I/O P P I/O I/O 光纤信号检测； PECL电平信号，显示光纤接收是否有效。能带隙地信号能带隙引脚 2.5V接收端口电源 2.5V发送端口电源物理层接收端的正极物理层接收端的负极接收端口地发送端口地物理层发送端口正极物理层发送端口负极描述 9

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5.6其他

引脚号 41 名称 TEST 类型 I 操作模式；在正常模式时被强制置接地。复位信号；描述 40 PWRST# I 复位DM9000，低电平有效。该引脚被置上后 DM9000A 将在5us后完成初始化。 5.7电源引脚

引脚号 23，30，42 15，33，45 名称 VDD GND 类型 P P 数字电源 3.3V电源输入数字地描述 5.8捆绑引脚列表（Strap pins table）

1:上拉1K~10K，0：浮空（默认）引脚号名称中断极性描述 20 EECK 1=中断引脚低有效 0=中断引脚高有效数据宽度 21 EECS 1=8位 0=16位在8位模式下，INT引脚输出类型 1=开漏输出 0=强制输出 25 GP6 6. 控制和状态寄存器列表

DM9000A拥有一系列的控制和状态寄存器，这些寄存器可以被处理器所访问。这些寄存器是按字节对齐的。所有的CSRs在软件或者硬件复位后都将被置为默认值，除非他们被另外标识。编号 1 2 寄存器 NCR NSR 网络控制寄存器网络状态寄存器 10

描述偏移地址 00H 01H 复位后默认值 00H 00H 南京电研电力自动化股份有限公司 http://www.naco.com.cn

3 4 5 6 7 8 9 10 11 12 13 14 15 16 17 18 19 20 21 22 23 24 25 26 27 28 29 30 31 32 33 34 35 36 37 38 39 40 41 42 43 TCR TSR I TSR II RCR RSR ROCR BPTR FCTR FCR EPCR EPAR EPDRL EPDRH WCR PAR MAR GPCR GPR TRPAL TRPAH RWPAL RWPAH VID PID CHIPR TCR2 OCR SMCR ETXCSR TCSCR RCSCSR MRCMDX MRCMD MRRL MRRH MWCMDX MWCMD MWRL MWRH TXPLL 发送控制寄存器发送状态寄存器1 发送状态寄存器2 接收控制寄存器接收状态寄存器接收溢出计数寄存器背压阈值寄存器流控制阈值寄存器 TX/RX流控制寄存器 EEPROM&PHY控制寄存器 EEPROM&PHY地址寄存器 EEPROM&PHY低字节数据寄存器 EEPROM&PHY高字节数据寄存器唤醒控制寄存器物理地址寄存器广播地址寄存器通用目的控制寄存器（8bit模式）通用目的寄存器 TX SRAM读指针地址低字节 TX SRAM读指针地址高字节 RX SRAM写指针地址低字节 RX SRAM写指针地址高字节厂家ID 产品ID 芯片版本发送控制寄存器2 操作控制寄存器特殊模式控制寄存器即将发送控制/状态寄存器发送校验和控制寄存器接收校验和控制状态寄存器内存数据预取读命令寄存器（地址不加1） 02H 03H 04H 05H 06H 07H 08H 09H 0AH 0BH 0CH 0DH 0EH 0FH 10H~15H 16H~1DH 1EH 1FH 22H 23H 24H 25H 28H~29H 2AH~2BH 2CH 2DH 2EH 2FH 30H 31H 32H F0H F1H F2H F4H F5H F6H F8H FAH FBH FCH 00H 00H 00H 00H 00H 00H 37H 38H 00H 00H 40H XXH XXH 00H 由EEPROM决定 XXH 01H XXH 00H 00H 00H 0CH 0A46H 9000H 18H 00H 00H 00H 00H 00H 00H XXH XXH XXH 00H 00H XXH XXH 00H 00H XXH MRCMDX1 内存数据读命令寄存器（地址不加1）内存数据读命令寄存器（地址加1）内存数据读地址寄存器低字节内存数据读地址寄存器高字节内存数据写命令寄存器（地址不加1）内存数据写命令寄存器（地址加1）内存数据写地址寄存器低字节内存数据写地址寄存器高字节 TX数据包长度低字节寄存器 11

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44 45 46 TXPLH ISR IMR TX数据包长度高字节寄存器中断状态寄存器中断屏蔽寄存器 FDH FEH FFH XXH 00H 00H 关于默认值的要点（Key to Default）

在下面寄存器描述中，默认栏采用如下形式： , 其中

1 该位设为逻辑1 0 该位设为逻辑0 X 没有默认值

P 电源复位恢复默认值 H 硬件复位恢复默认值 S 软件复位恢复默认值 E 从EEPROM得到默认值

T 从捆绑引脚（strap pin）得到默认值 : RO = 只读

RW = 可读可写 R/C = 可读/擦除

RW/C1=可读可写/通过写1擦除 WO = 只写

保留位被隐藏且应写0，在读访问时保留位没有定义。

6.1网络控制寄存器（NCR）

Network Control Register ( 00H ) Bit 7 Name RESERVED Default X,RO 保留在8位工作模式下，唤醒事件使能；当设置1时，使能唤醒事件功能；清除该位将会清除所有唤醒事件的状态；该位不会受到软件复位的影响； Description 6 WAKEEN P0,RW 5 4 3 RESERVED FCOL FDX 0,RO PHS0,RW PHS0,RO 保留强制冲突模式，用于检测。内部PHY全双工模式回环模式（Loopback） 00 正常； 01 MAC内部回环； 10内部PHY 100M模式数字回环； 11保留；置1软件复位，10us后自动清零。 2：1 LBK PHS00, RW 0 RST PH0,RW 12

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6.2网络状态寄存器（NSR）

Network Status Register ( 01H ) Bit 7 6 5 4 3 2 1 0 Name SPEED LINKST WAKEST RESERVED TX2END TX1END RXOV RESERVED Default X,RO X,RO P0, RW/C1 0,RO PHS0, RW/C1 PHS0, RW/C1 PHS0,RO 0,RO Description 媒介速度，在内部PHY激活情况下，0表示100Mbps，1表示10Mbps。当LINKST=0时，此位无意义。连接状态，0为连接失败，1为已连接。唤醒事件状态。读取或写1将清除该位（工作在8位模式下）。软件复位后该位不受影响。保留 TX（发送）数据包2完成标志。读取或写1将清零该位，数据包2传输完成。 TX（发送）数据包1完成标志。读取或写1将清零该位，数据包1传输完成。 RX（接收）FIFO（先进先出缓存）溢出标志。保留 6.3发送控制寄存器（TCR）

TX Control Register ( 02H ) Bit 7 6 Name RESERVED TJDIS Default 0,RO PHS0,RW Description 保留 Jabber传输禁止 1=禁止Jabber传输定时器（2048字节）； 0=使能；严重冲突模式控制。 0=当冲突计数多于15则终止本次数据包； 1=始终尝试发发送本次数据包。禁止为数据包II添加填充禁止为数据包II添加CRC校验。禁止为数据包I添加填充禁止为数据包I添加CRC校验。 TX（发送）请求。发送完成后自动清零该位。 5 4 3 2 1 0 EXCECM PAD_DIS2 CRC_DIS2 PAD_DIS1 CRC_DIS1 TXREQ PHS0,RW PHS0,RW PHS0,RW PHS0,RW PHS0,RW PHS0,RW 6.4数据包I发送状态寄存器I（TSR I）

TX Status Register I for packet index I ( 03H ) Bit 7 6 Name TJTO LC Default PHS0,RO PHS0,RO Description Jabber传输超时。该位置位表示由于多于2048字节数据被传输而导致数据帧被截掉。载波信号丢失。 13

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该位置位表示在帧传输时发生载波信号丢失。在内部回环模式下该位无效。 5 NC PHS0,RO 无载波信号。该位置位表示在帧传输时无载波信号。在内部回环模式下该位无效。冲突延迟。该位置位表示在64字节的冲突窗口后又发生冲突。数据包冲突。该位置位表示传输过程中发生冲突。额外冲突。该位置位表示由于发生了第16次冲突（即额外冲突）后，传送被终止。保留 4 3 2 LC COL EC PHS0,RO PHS0,RO PHS0,RO 0,RO 1：0 RESERVED 6.5数据包II发送状态寄存器II（TSR II）

TX Status Register II for packet index II ( 04H ) Bit 7 Name TJTO Default PHS0,RO Description Jabber传输超时。该位置位表示由于多于2048字节数据被传输而导致数据帧被截掉。载波信号丢失。该位置位表示在帧传输时发生载波信号丢失。在内部回环模式下该位无效。无载波信号。该位置位表示在帧传输时无载波信号。在内部回环模式下该位无效。冲突延迟。该位置位表示在64字节的冲突窗口后又发生冲突。数据包冲突。该位置位表示传输过程中发生冲突。额外冲突。该位置位表示由于发生了第16次冲突（即额外冲突）后，传送被终止。保留 6 LC PHS0,RO 5 NC PHS0,RO 4 3 2 LC COL EC PHS0,RO PHS0,RO PHS0,RO 0,RO 1：0 RESERVED 6.6接收控制寄存器（RCR）

RX Control Register ( 05H ) Bit 7 6 5 Name RESERVED WTDIS DIS_LONG Default PHS0,RW PHS0,RW PHS0,RW Description 保留看门狗定时器（2048字节）禁止。 1禁止，0使能。丢弃长数据包。 1为丢弃数据包长度超过1522字节的数据包。 14

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4 3 2 1 0 DIS_CRC ALL RUNT PRMSC RXEN PHS0,RW PHS0,RW PHS0,RW PHS0,RW PHS0,RW 丢弃CRC校验错误数据包。允许广播。允许小于最小长度的数据包。各种模式（Promiscuous Mode）接收使能 6.7接收状态寄存器（RSR）

RX Status Register ( 06H ) Bit 7 6 5 4 3 Name RF MF LCS RWTO PLE Default PHS0,RO PHS0,RO PHS0,RO PHS0,RO PHS0,RO Description 超短数据帧 1=该位置位表示接收到小于64字节的帧。多点传送帧 1=该位置位表示接收到帧包含多点传送地址。冲突延迟 1=该位置位表示在帧接收过程中发生冲突延迟。接收看门狗定时溢出 1=该位置位表示接收到大于2048字节数据帧。物理层错误 1=该位置位表示在帧接收过程中发生物理层错误。对齐错误（Alignment） 1=该位置位表示接收到的帧结尾处不是字节对齐，即不是以字节为边界对齐。 CRC校验错误 1=该位置位表示接收到的帧CRC校验错误。接收FIFO缓存溢出 1=该位置位表示在帧接收时发生FIFO溢出。 2 AE PHS0,RO 1 0 CE FOE PHS0,RO PHS0,RO 6.8接收溢出计数寄存器（ROCR）

Receive Overflow Counter Register ( 07H ) Bit 7 Name RXFU Default PHS0,R/C Description 接收溢出计数器溢出。该位置位表示ROC（接收溢出计数器）发生溢出。接收溢出计数器。该计数器为静态计数器，指示FIFO溢出后，当前接收溢出包的个数。 6:0 ROC PHS0,R/C 6.9背压阈值寄存器（BPTR）

Back Pressure Threshold Register (08H) Bit

Name

Default

Description

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背压阈值最高值。当接收SRAM空闲空间低于该阈值，则MAC将产生一个拥挤状态。1=1K字节。默认值为3H，即3K字节空闲空间。不要超过SRAM大小。拥挤状态时间。默认为200 us。 0000 为5us 0001为10us 0010为15us 0011为25us 0100为50us 0101为100us 0110为150us 0111为 200us 1000为250us 1001为300us 1010为350us 1011为400us 1100为450us 1101为500us 1110为550us 1111为600us 7:4 BPHW PHS3, RW 3:0 JPT PHS7, RW 6.10流控制阈值寄存器（FCTR）

Flow Control Threshold Register ( 09H ) Bit Name Default Description RX FIFO缓存高位溢出门限。当RX SRAM空闲空间小于该门限值，则发送一个暂停时间（pause_time）为FFFFH的暂停包。若该值为0，则无接收空闲空间。1=1K字节。默认值为3H，即3K字节空闲空间。不要超过SRAM大小。 RX FIFO缓存低位溢出门限。当RX SRAM空闲空间大于该门限值，则发送一个暂停时间7:4 HWOT PHS3, RW 3:0 LWOT PHS8, RW （pause_time）为0000H的暂停包。当溢出门限最高值的暂停包发送之后，溢出门限最低值的暂停包才有效。默认值为8K字节。不要超过SRAM大小。 1=1K字节 6.11接收/发送流控制寄存器（RTFCR）

RX/TX Flow Control Register ( 0AH ) Bit 7 Name TXP0 Default HPS0,RW Description 1发送暂停包。 16

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发送完成后自动清零，建立TX暂停包时间为0000H。 6 5 TXPF TXPEN HPS0，RW HPS0，RW 1发送暂停包。发送完成后自动清零，建立TX暂停包时间为FFFFH。强制发送暂停包使能。为高低位流门限控制使能发送暂停包。背压模式。 4 BKPA HPS0，RW 该模式仅在半双工模式下有效。当任意数据包到来且RX SRAM超出背压阈值最高值（BPHW）时，产生一个拥挤状态。背压模式。 3 BKPM HPS0，RW 该模式仅在半双工模式下有效。当数据包DA匹配且RX SRAM超出背压阈值最高值（BPHW）时，产生一个拥挤状态。接收暂停包状态、锁存、和读清晰。接收暂停包当前状态。流控制使能。 1：使能流控制模式。（即可以禁止DM9000A 发送功能） 2 1 0 RXPS RXPCS FLCE HPS0,R/C HPS0,RO HPS0,RW 6.12 EEPROM&PHY控制寄存器（EPCR）

EEPROM & PHY Control Register ( 0BH ) Bit 7:6 5 4 3 2 1 0 Name REEP WEP EPOS ERPRR ERPRW ERRE Default PH0,RW PH0,RW PH0,RW PH0,RW PH0,RW PH0,RO Description 保留重新加载EEPROM。驱动程序需要在该操作完成后清零该位。 EEPROM写使能。 EEPROM或PHY操作选择位。复位为0 0选择EEPROM，1选择PHY。 EEPROM读，或PHY寄存器读命令。驱动程序需要在该操作完成后清零该位。 EEPROM写，或PHY寄存器写命令。驱动程序需要在该操作完成后清零该位。 EEPROM或PHY的访问状态。 1表示EEPROM或PHY正在被访问。 RESERVED 0,RO 6.13 EEPROM&PHY地址寄存器（EPAR）

EEPROM & PHY Address Register ( 0CH ) Bit 7:6 5:0 Name PHY_ADR EROA Default PH01,RW PH0,RW Description PHY地址的低两位（bit1，bit0），而PHY地址的bit[4:2]强制为000。如果要选择内部PHY，那么此两位强制为01，实际应用中要强制为01。 EEPROM字地址或PHY寄存器地址。 17

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6.14 EEPROM&PHY数据寄存器（EPDRL/EPDRH）

EEPROM & PHY Data Register (EE_PHY_L：0DH、 EE_PHY_H：0EH) Bit 7:0 7:0 Name EE_PHY_L EE_PHY_H Default PH0,RW PH0,RW Description EEPROM或PHY数据寄存器低字节从EEPROM或PHY读写低字节的数据内容 EEPROM或PHY数据寄存器高字节从EEPROM或PHY读写高字节的数据内容 6.15唤醒控制寄存器（WCR）

Wake Up Control Register ( 0FH ) (in 8-bit mode) Bit 7:6 5 4 3 2 1 0 Name RESERVED LINKEN SAMPLEEN MAGICEN LINKST SAMPLEST MAGICST Default 0,RO P0,RW P0,RW P0,RW P0,RO P0,RO P0,RO Description 保留。 1使能“连接状态改变”唤醒事件。该位不受软件复位影响。 1使能“Sample帧”唤醒事件。该位不受软件复位影响。 1使能“Magic Packet”唤醒事件。该位不受软件复位影响。 1表示发生了连接改变事件和连接状态改变事件。该位不受软件复位影响。 1表示接收到“Sample帧”和发生了“Sample帧”事件。该位不受软件复位影响。 1表示接收到“Magic Packet”和发生了“Magic Packet”事件。该位不受软件复位影响。 6.16物理地址（MAC）寄存器（PAR）

Physical Address Register ( 10H~15H ) 用来保存6个字节的MAC地址。 Bit 7:0 7:0 7:0 7:0 7:0 7:0

Name PAB5 PAB4 PAB3 PAB2 PAB1 PAB0 Default E,RW E,RW E,RW E,RW E,RW E,RW Description 物理地址(MAC) 字节5 (15H) 物理地址(MAC) 字节4 (14H) 物理地址(MAC) 字节3 (13H) 物理地址(MAC) 字节2 (12H) 物理地址(MAC) 字节1 (11H) 物理地址(MAC) 字节0 (10H) 18

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6.17广播地址寄存器（MAR）

Multicast Address Register ( 16H~1DH ) Bit 7:0 7:0 7:0 7:0 7:0 7:0 7:0 7:0 Name MAB7 MAB6 MAB5 MAB4 MAB3 MAB2 MAB1 MAB0 Default X,RW X,RW X,RW X,RW X,RW X,RW X,RW X,RW Description 多播地址字节7（1DH）多播地址字节6（1CH）多播地址字节5（1BH）多播地址字节4（1AH）多播地址字节3（19H）多播地址字节2（18H）多播地址字节1（17H）多播地址字节0（16H） 6.18通用目的控制寄存器（GPCR）

General purpose control Register ( 1EH ) (in 8-bit mode) Bit 7 6:4 Name RESERVED GPC64 Default PH0,RO PH,111,RO Description 保留通用目的控制GP6~GP4；分别定义GP6~GP4引脚的输入输出方向；这些位都被强制置为1，所以GP6~GP4只能输出。通用目的控制GP3~GP1；分别定义GP3~GP1引脚的输入输出方向；当为1时，通用目的寄存器（GPR）相应位的方向为输出，其他为输入。保留 3:1 GPC31 PH,000,RW 0 RESERVED PH1,RO 6.19通用目的寄存器（GPR）

General Purpose Register ( 1FH ) Bit 7 6-4 Name RESERVED GPO Default 0,RO PH0,RW Description 保留通用目的输出GP6~GP4（8位模式）；这些位的值和引脚GP6~GP4分别对应；通用目的（在8位模式中）； 1、当GPIO控制寄存器GPC31对应位为1时（GPIO3~1输出），该位上的值就为GP3~GP1引脚上输出的值。 2、当GPIO控制寄存器GPC31对应位为0时（GPIO3~1输入），该位上的值将作为GP3~GP1引脚的输入值。 PHY掉电控制； 1：PHY掉电； 19

3:1 GPIO PH0,RW 0 PHYPD ET1,RW 南京电研电力自动化股份有限公司 http://www.naco.com.cn

0：PHY激活；

6.20 TX SRAM读指针地址寄存器（TRPAL/TRPAH）

TX SRAM Read Pointer Address Register (22H~23H) Bit 7:0 7:0 Name TRPAH TRPAL Default PS0,RO PS0.RO Description 发送SRAM读指针地址高字节（23H）发送SRAM读指针地址低字节( 22H ) 6.21 RX SRAM写指针地址寄存器（RWPAL/RWPAH）

RX SRAM Write Pointer Address Register (24H~25H) Bit 7:0 7:0 Name RWPAH RWPAL Default PS,0CH,RO PS,0CH,RO Description 接收SRAM指针地址高字节 (25H) 接收SRAM指针地址低字节 (24H) 6.22厂家ID寄存器（VID）

Vendor ID Register (28H~29H) Bit 7:0 7:0 Name VIDH VIDL Default Description PHE,0AH,RO 生产厂家序列号高字节（29H） PHE,46H,RO 生产厂家序列号低字节（28H） 6.23产品ID寄存器（PID）

Product ID Register (2AH~2BH) Bit 7:0 7:0 Name PIDH PIDL Default Description PHE,90H,RO 产品序列号高字节（2BH） PHE,00H.RO 产品序列号低字节（2AH） 6.24芯片版本寄存器（CHIPR）

Chip Revision Register (2CH) Bit 7:0 Name CHIPR Default 18H,RO Description 芯片修订版本 6.25发送控制寄存器2（TCR2）

Transmit Control Register 2 ( 2DH ) Bit 7 Name LED Default PH0,RW Description LED模式。 20

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1=设置LED引脚为模式1， 0=设置LED引脚为模式0或根据EEPROM的设定。 6 5 4 RLCP DTU ONEPM PH0,RW PH0,RW PH0,RW 重试冲突延时数据包 1=重新发送有冲突延迟的数据包。 1=禁止重新发送“underruned”数据包。（不完整包）单包模式。 1=发送完成前发送一个数据包的命令能被执行， 0=发送完成前发送最多两个数据包的命令能被执行。帧间间隔设置。 0XXX为96bit 1000为64bit 1001为72bit 1010为80bit 1011为88bit 1100为96bit 1101为104bit 1110为112bit 1111为120bit 3~0 IFGS PH0,RW 6.26操作测试控制寄存器（OCR）

Operation Test Control Register ( 2EH ) Bit Name Default Description 7-6 SCC 系统时钟控制设置内部系统时钟 00：50MHz PH0,RW 01：20MHz 10：100MHz 11：保留 PH0,RW 保留 PH0,RW 内部SRAM输出使能始终开启 PH0,RW 内部SRAM片选始终开启 PH0,RW 为测试用内部PHY操作模式 5 4 3 2-0 保留 SOE SCS PHYOP 6.27特殊模式控制寄存器（SMCR）

Special Mode Control Register ( 2FH ) Bit Name Default Description 7 6-3 2 1 SM_EN 保留 FLC FB1 PH0,RW 特殊模式使能 PH0,RW 保留 PH0,RW 强制冲突检测 PH0,RW 强制最长“Back-off”时间 21

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FB2

PH0,RW 强制最短“Back-off”时间

6.28即将发送控制/状态寄存器（ETXCSR）

Early Transmit Control/Status Register ( 30H ) Bit Name Default Description 7 6 5 4-2 ETE ETS2 ETS1 保留 HPS0,RW 即将发送使能使能bits[2:0] HPS0,RO 即将发送状态2 HPS0,RO 即将发送状态1 000,RO 保留即将发送门限当写到发送FIFO缓存里的数据字节数达到该门限，则开始传输。 Bit-1 Bit-0 门限 HPS0,RW ------ ------- ------ 0 0 : 12.5% 0 1 : 25% 1 0 : 50% 1 1 : 75% 1-0 ETT 6.29校验和控制寄存器（CSCR）

Check Sum Control Register ( 31H ) Bit Name Default Description 7-3 2 1 0 保留 0,RO 保留 UDPCSE HPS0,RW UDP校验和产生使能 TCPCSE HPS0,RW TCP检验和产生使能 IPCSE HPS0,RW IP校验和产生使能 6.30接收校验和控制状态寄存器（RCSCSR）

Receive Check Sum Status Register ( 32H ) Bit Name Default Description 7 6 5 4 3 UDPS TCPS IPS UDPP TCPP HPS0,RO HPS0,RO HPS0,RO UDP校验和状态 1=UDP数据包校验失败 TCP校验和状态 1=TCP数据包校验失败 IP校验和状态 1=IP数据包校验失败 HPS0,RO UDP数据包 HPS0,RO TCP数据包 22

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2 1 IPP RCSEN HPS0,RO IP数据包接收检验和检验使能 HPS0,RW 当置1时，校验和状态位（bit7-2）将存储到数据包的各自的报文头的第一个字节（bit7-2） HPS0,RW 丢弃校验和错误的数据包当置1时若IP/TCP/UDP的校验和域错误，则丢弃该数据包 0 DCSE 6.31内存数据预取读命令寄存器（地址不加1）(MRCMDX)

Memory Data Pre-Fetch Read Command without Address Increment Register (F0H) Bit Name Default Description 7-0 MRCMDX X,RO 从接收SRAM中读数据，读取该指令之后，指向内部SRAM的读指针不变。DM9000A开始预取SRAM中数据到内部数据缓冲中。 6.32内存数据读命令寄存器（地址不加1）(MRCMDX1)

Memory Data Read Command without Address Increment Register (F1H) Bit Name Default Description 7-0 MRCMDX1 X,RO 从接收SRAM中读数据，读取该指令之后，指向内部SRAM的指针不变。 6.33内存数据读命令寄存器（地址加1）(MRCMD)

Memory Data Read Command with Address Increment Register (F2H) Bit Name Default Description 7-0 MRCMD X,RO 从接收SRAM中读数据，读取该指令之后，读指针根据操作模式（8位或16位）增加1或2。 6.34内存数据读地址寄存器（MRRL/ MRRH）

Memory Data Read_address Register (F4H~F5H) Bit Name Default Description 7-0 7-0 MDRAH MDRAL PHS0,RW 存储器读地址高字节。当IMR第7位为1时它被置为0Ch PHS0,RW 存储器读地址低字节。 6.35内存数据写命令寄存器（地址不加1）(MWCMDX)

Memory Data Write Command without Address Increment Register (F6H)

Bit

Name

Default

Description

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7-0

MWCMDX

X,WO

向发送SRAM中写数据。写该指令之后，写指针不变。

6.36内存数据写命令寄存器（地址加1）(MWCMD)

Memory Data Write Command with Address Increment Register (F8H) Bit Name Default Description 7-0 MWCMD X,WO 向发送SRAM中写数据。写该指令之后，指写指针根据操作模式（8位或16位）增加1或2。 6.37内存数据写地址寄存器（MWRL/ MWRH）

Memory data write_address Register (FAH~FBH) Bit Name Default Description 7-0 7-0 MDRAH MDRAL PHS0,RW 存储器数据写地址高字节 PHS0,RW 存储器数据写地址低字节 6.38发送数据包长度寄存器（TXPLL/TXPLH）

TX Packet Length Register (FCH~FDH) Bit Name Default Description 7-0 7-0 TXPLH TXPLL X,RW X,RW 发送数据包长度高字节发送数据包长度低字节 6.39中断状态寄存器（ISR）

Interrupt Status Register (FEH) Bit Name Default Description 7 6 5 4 3 2 1 0 IOMODE 保留 LNKCHG UDRUN ROO ROS PT PR T0,RO RO 0：16位模式 1：8位模式保留 PHS0,RW/C1 连接状态改变 PHS0,RW/C1 发送“Underrun” PHS0,RW/C1 接收溢出计数器溢出 PHS0,RW/C1 接收溢出 PHS0,RW/C1 数据包发送 PHS0,RW/C1 数据包接收 6.40中断屏蔽寄存器（IMR）

Interrupt Mask Register (FFH)

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Bit Name Default Description 7 6 5 4 3 2 1 0 PAR 保留 LNKCHGI UDRUNI ROOI ROI PTI PRI HPS0,RW RO PHS0,RW PHS0,RW PHS0,RW PHS0,RW PHS0,RW PHS0,RW 使能SRAM的读/写指针在指针地址超过SRAM的大小时自动跳回起始位置。需要驱动程序设置该位，若设置该位，REG_F5将自动置为0CH。保留使能连接状态改变中断使能发送“Underrun”中断使能接收溢出计数器溢出中断使能接收溢出中断使能数据包发送中断使能数据包接收中断 7．EEPROM格式

EEPROM Format（16Byte）名称 MAC地址字 (Word) 0~2 偏移量 (Byte) 0-5 6字节以太网地址 Bit 1:0=01：更新厂家ID和产品ID Bit 3:2=01：接受Word6 [8:0]的设置 Bit 5:4=01：保留 Bit 7:6=01：接受Word7 [3:0]的设置（8位模式） Bit 9:8=01：保留 Bit 11:10=01：接受Word7 [7]的设置 Bit 13:12=01：接受Word7 [8]的设置 Bit 15:14=01：接受Word7 [15:12]的设置 2字节生产厂家ID（默认：0A46H） 2字节产品ID（默认：9000H）当Word3[3:2]=01时，这些位控制CS#，IOR#，IOW#和INT引脚极性。 Bit 0：当置位时CS#引脚为低有效（默认低有效） Bit 1：当置位时IOR#引脚为低有效（默认低有效） Bit 2：当置位时IOW#引脚为低有效（默认低有效） Bit 3：当置位时INT引脚为低有效（默认高有效） Bit 4：INT引脚为集电极开路（默认强制输出） Bit 5~15：保留 Bit 0：当置位时WAKE引脚为低有效（默认高有效） Bit 1：当置位时WAKE引脚脉冲模式（默认电平模式） Bit 2：当置位时唤醒事件使能（默认禁止） Bit 3：当置位时链接改变唤醒事件允许（默认禁止） Bit 6~4：保留 Bit 7：LED模式1（默认模式0） 25

描述自动加载控制 3 6-7 厂家ID 产品ID 4 5 8-9 10-11 引脚控制 6 12-13 唤醒模式控制 7 14-15 南京电研电力自动化股份有限公司 http://www.naco.com.cn

Bit 8：上电后内部PHY被允许（默认禁止） Bit 11~9：保留

Bit 13~12：01=在16位模式下LED2作为IOWAIT Bit 13~12：10=在16位模式下LED2作为WAKE、 Bit 14：1= AUTO-MDIX开，0= AUTO-MDIX关（默认开）

Bit 15：在16位模式下LED1作为IO16

8．PHY寄存器描述

PHY Register Discription

ADD Name 15 Reset 14 Loop back 13 12 11 10 Isolate 9 Restart 8 Full 7 Coll Test 6 5 4 3 Reserved 2 1 0 Speed Auto-N Power select Enable Down 00 CONTROL Auto-N Duplex 0 T4 0 TXFDX Cap. 1 1 0 0 0 1 0 000_0000 Pream Auto-N Remote Auto-N Supr. Compl. Fault Cap. Link Jabber Extd Cap. TXHDX 10FDX 10HDX Cap. Cap. Cap. 01 STATUS Cap. Reserved Status Detect 0 1 0 0 1 0 1 1 0 1 1 0 1 0 0 0000 0 1 1 1 0 0 0 0 0 1 0 0 0 0 0 1 1 02 PHYID1 PHYID2 0 1 Next Page LP Next Page 03 Model NO (01010) TX FDX TX HDX 10FDX 10HDX Adv LP Adv LP Adv LP Adv LP Version NO (0000) 04 Auto-Neg. Advertise 05 FLP Rcv Remote Ack LP Ack Fault LP RF Reserved FC Adv T4 Adv Advertised Protocol Selector Field Link Part Ability Reserved LP FC LP T4 TX FDX TX HDX 10 FDX 10 HDX Link Partner Protocol Selector Field Auto-Neg. 06 Expansion Reserved Pardet LP Next Next Pg Next Pg LP.autoFault Pg Able Able Rcv n.Cap. Remote Loopout 16 Specified Config Specified Conf/Stat 10T Conf/Stat PWDOR Specified Config BP 4B5B BP SCR BP ALIGN BP_adp ReservOK ed TX Reserved Force 100lnk Reserved RPDCTReset Pream Sleep mode R-EN St.mch Supr. 17 100 FDX 100 HDX LP Enable 10 FDX HBE 10 HDX SQUE JAB Reversed PHY ADDR[4:0] Auto-N.Monitor Bit[3:0] 18 Rsvd Enable Enable Enable PD10DRV Reserved Polarity reverse 19 Reserved PD100I PDchip PDcrm PDaeq PDdrv PDecli PDeclo PD10 20 TSTSE1 TSTSE 2 FORCE FORCE _TXSD _FEF Reserved MDIX_AutoNeMdix_fiMdix_ MonSelMonSelReser1 0 PD_ value CNTL g_llpbk xValue down ved

关于默认值要点：（Key to Default）

下面的寄存器描述中，默认栏采用如下形式： <复位值>，<访问类型>/<属性>

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<复位值>：

1 位设置为逻辑1 0 位设置为逻辑0 X 无默认值 <访问类型>：

RO =只读 RW =读/写 <属性>：

SC =自清除 P =永久设定值 LL =锁存低 LH=锁存高

8.1基本模式控制寄存器（BMCR）

Basic mode control register (00) 位位名称默认描述 0.15 复位 1：软件复位； 0：正常操作； 0，RW/SC 该位设置PHY寄存器回到默认状态。复位操作完成后，该位自动清零。 1：回环使能； 0：正常操作；在100Mbps操作模式下，设置该位可引起解扰频器失去同步以及在接收前产生一个720ms“死时间”。 1：100Mbps 0：10Mbps 连接速度既可以根据该位选择，也可以根据第12位，即自动协商选择。当自动协商使能时，即第12位为1，该位将会返回自动协商后的速度值。 1：自动协商使能；第13位和第8位的值将反应自动协商后的状态。 0.14 回环 0，RW 0.13 速度选择 1，RW 0.12 自动协商使能 1，RW 0.11 掉电 0，RW 1：掉电 0：正常操作在掉电状态下，PHY应当对操作处理作出响应。 0.10 0.9 隔离重启自动协商 0，RW 在应用中强制为0。 0，RW/SC 1：重新初始化自动协商。 27

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当自动协商未使能（寄存器第12位被清除），该位无效，必须清除。自动协商初始化完成后，该位自动清除。 0：为正常操作 1：全双工操作。当自动协商禁止时（寄存器的第12位清除），双工模式允许被选择。当自动协商使能时，该位反应自动协商选择的双工模式。 0：正常操作 1：冲突检测使能。当置位时，表示在发送期间产生了冲突。 0：正常操作保留读为“0”，忽略写。 0.8 双工模式 1，RW 0.7 冲突检测 0，RW 0.6- 0.0 保留 0，RO 8.2基本模式状态寄存器（BMSR）

Basic Mode Status Register (01) 位 1.15 位名称 100BASE-T4 模式 100BASE-TX全双工模式 100BASE-TX半双工模式 10BASE-T 全双工模式 10BASE-T 半双工模式保留默认 0，RO/P 描述 1：DM9000A可以工作在100BASE-T4模式； 0：DM9000A不能工作在100BASE-T4模式； 1：DM9000A可以工作在100BASE-TX全双工模式； 0：DM9000A不能工作在100BASE-TX全双工模式； 1：DM9000A可以工作在100BASE-TX半双工模式； 0：DM9000A不能工作在100BASE-TX半双工模式； 1：DM9000A可以工作在10BASE-T全双工模式； 0：DM9000A不能工作在10BASE-T全双工模式； 1：DM9000A可以工作在10BASE-T半双工模式； 0：DM9000A不能工作在10BASE-T半双工模式；读为“0”，忽略写。 1：PHY接受前导抑制帧； 0：PHY不接受前导抑制帧； 1：自动协商过程结束； 0：自动协商过程未结束； 28

1.14 1，RO/P 1.13 1，RO/P 1.12 1，RO/P 1.11 1.10- 1.7 1.6 1，RO/P 0，RO MF前导抑制 1，RO 1.5 自动协商完成 0，RO 南京电研电力自动化股份有限公司 http://www.naco.com.cn

1：远程错误状态检测（通过读或者芯片复位清除）；错误标准和检查方法是DM9000A的执行特性。该位0，RO/LH 在ANLPAR寄存器中的RF位（bit 13，寄存器地址05）置位时置位。 0：没有远程错误状态检测； 1：DM9000A可以实现自动协商； 0：DM9000A不可以实现自动协商； 1.4 远程错误 1.3 自动协商功能 1，RO/P 1.2 连接状态 1：已建立有效连接（10Mbps或100Mbps操作）； 0：未建立连接； 0，RO/LL 该位带锁存功能，以至于当发生一个连接错误状态时将使该位保持为0，直到读该位时才置1。 1：Jabber状态检测； 0：无Jabber状态检测； 0，RO/LH 该位带锁存功能，Jabber状态检测使该位置位。只有当DM9000A复位或者读寄存器操作时，该位才会被清除。该位仅工作在10Mbps模式下。 1：扩展寄存器功能； 0：只有基本功能，不扩展； 1.1 Jabber检测 1.0 扩展寄存器功能 1，RO/P 8.3 PHY ID标识符寄存器#1（PHYID1）

PHY ID Identifier Register #1 (02)

PHY ID标识符寄存器#1和#2用来共同标识一个DM9000A标识符。该标识符由唯一机构标识符（OUI）、厂家版本号和修正版本号组成。IEEE分配给DAVICOM半导体的OUI为00606E。

位位名称默认描述 OUI最高有效位; 该寄存器加载OUI(00606E)的3~18位到该寄存器的2.15-2.0 OUI_MSB <0181h> 15~0位。OUI最高两位被忽略（这两位在IEEE标准中作为第1位和第2位） 8.4 PHY ID标识符寄存器#2（PHYID1）

PHY ID Identifier Register #2 (03) 位位名称默认描述 OUI最低有效位 <101110>,RO/P OUI(00606E)的19~24位被相应地映射到该寄存器的第15~10位。 <001010>,RO/P 厂家版本号 29

3.15-3.10 OUI_LSB 3.9-3.4 VNDR_MDL 南京电研电力自动化股份有限公司 http://www.naco.com.cn

厂家版本号的6位被映射到第9~4位（最高有效位至第9位） 3.3-3.0 MDL_REL <0000>,RO/P 修正版本号修正版本号的4位被映射到第3到0位（最高有效位至第4位） 8.5自动协商通知寄存器（ANAR）

Auto-negotiation Advertisement Register (04)(default:0x01e1)

该寄存器包含该DM9000A器件的通知能力，连接对象信号在自动协商期间被发送到其连接对象。

位位名称默认描述下一页指示 0：无下一页可用； 1：下一页可用； DM9000A无下一页，所以该位永久设置为0 应答 1：连接对象信号接收应答； 0：无应答； DM9000A自动协商状态机将在FLP突发发送时自动控制该位，并在恰当的时候置位。远程错误 1：本地设备感知一个错误状态 0：检测无错误保留写0，忽略读。流控制 1：控制器芯片支持流控制； 0：控制器芯片不支持流控制； 100BASE-T4支持 1：本地设备支持100BASE-T4模式； 0：本地设备不支持100BASE-T4模式； DM9000A不支持100BASE-T4，所以该位恒被设置为0。 100BASE-TX全双工支持 1：本地设备支持100BASE-TX全双工模式； 0：本地设备不支持100BASE-TX全双工模式； 4.15 NP 0,RO/P 4.14 ACK 0,RO 4.13 RF 0,RW 4.12-4.11 保留 X,RW 4.10 FCS 0,RW 4.9 T4 0,RO/P 4.8 TX_FDX 1,RW 30

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100BASE-TX半双工支持 1：本地设备支持100BASE-TX半双工模式； 0：本地设备不支持100BASE-TX半双工模式； 10BASE-T全双工支持 1：本地设备支持10BASE-T全双工模式； 0：本地设备不支持10BASE-T全双工模式； 10BASE-T半双工支持 1：本地设备支持10BASE-T半双工模式； 0：本地设备不支持10BASE-T半双工模式；协议选择位该位包含被节点支持的二进制编码协议选择器。<00001>表示该设备支持IEEE 802.3 CSMA/CD 4.7 TX_HDX 1,RW 4.6 10_FDX 1,RW 4.5 10_HDX 1,RW 4.4-4.0 Selector <00001>,RW 8.6自动协商连接对象寄存器（ANLPAR）

Auto-negotiation Link Partner Ability Register (05)

在自动协商期间，当接收到连接对象信号时，该寄存器包含连接对象的通知能力。

位位名称默认描述下一页指示 0：连接对象无下一页可用 1：连接对象下一页可用应答 1：连接对象信号接收应答； 0：无应答； DM9000A自动协商状态机将在FLP突发到达时自动控制该位，软件不能对该位进行写操作。远程错误 1：远程错误被连接对象指出 0：无远程错误被连接对象指出保留读0，忽略写流控制 1：控制器芯片支持连接对象流控制能力 5.15 NP 0,RO 5.14 ACK 0,RO 5.13 RF 0,RO 5.12-5.11 保留 0,RO 5.10 FCS 0,RO 31

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0：控制器芯片不支持连接对象流控制能力 100BASE-T4支持 1：连接对象支持100BASE-T4模式； 0：连接对象不支持100BASE-T4模式； 100BASE-TX全双工支持 1：连接对象支持100BASE-TX模式； 0：连接对象不支持100BASE-TX模式； 100BASE-TX半双工支持 1：连接对象支持100BASE-TX半双工模式； 0：连接对象不支持100BASE-TX半双工模式； 10BASE-T全双工支持 1：连接对象支持10BASE-T全双工模式； 0：连接对象不支持10BASE-T全双工模式； 10BASE-T半双工支持 1：连接对象支持10BASE-T半双工模式； 0：连接对象不支持10BASE-T半双工模式；协议选择位连接对象的二进制编码协议选择器 5.9 T4 0,RO 5.8 TX_FDX 0,RO 5.7 TX_HDX 0,RO 5.6 10_FDX 0,RO 5.5 10_HDX 0,RO 5.4-5.0 Selector <00000>,RO 8.7自动协商扩展寄存器（ANER）

Auto-negotiation Expansion Register (06) 位 6.15 位名称保留默认 0,RO 保留读0，忽略写本地设备并行检测错误 PDF=1：通过并行检测功能检测到一个错误 PDF=0：通过并行检测功能未检测到错误连接对象下一页可用 LP_NP_ABLE=1：连接对象下一页可用 LP_NP_ABLE=0：连接对象无下一页本地设备下一页可用 NP_ABLE=1：DM9000A下一页可用 32

描述 6.4 PDF 0,RO/LH 6.3 LP_NP_ABLE 0,RO 6.2 NP_ABLE 0,RO/P 南京电研电力自动化股份有限公司 http://www.naco.com.cn

NP_ABLE=0：DM9000A无下一页接收到新一页接收到一个新的连接码字页。当该寄存器本处理器读时改为被自动清除。连接对象自动协商可用该位的“1”表示连接对象支持自动协商 6.1 PAGE_RX 0,RO/LH 6.0 LP_AN_ABL 0,RO 8.8 DAVICOM指定配置寄存器（DSCR）

DAVICOM Specified Configuration Register (16) 位位名称默认描述旁路4B5B编码和5B4B解码 1：4B5B编码器和5B4B解码器功能旁路 0：正常4B5B和5B4B操作旁路扰频/解扰器功能 1：扰频/解扰器功能旁路 0：正常扰频/解扰器功能操作旁路符号对齐功能 1：接收功能旁路（解扰频，符号对齐和符号解码功能）。发送功能旁路（符号编码和扰频）。 0：正常操作旁路ADPOK 强制运行信号检查器（SD）。该寄存器只用于调试，不对用户开放。 1：强制SD工作； 0：正操操作；保留应用中强制为0 100BASE-TX模式控制 1：100BASE-TX操作保留保留应用中强制为0 强制100Mbps良好连接 0：正常100Mbps操作 33

16.15 BP_4B5B 0,RW 16.14 BP_SCR 0,RW 16.13 BP_ALIGN 0,RW 16.12 BP_ADPOK 0,RW 16.11 保留 0,RW 16.10 16.9 16.8 16.7 TX 保留保留 F_LINK_100 1,RW 0,RO 0,RW 0,RW 南京电研电力自动化股份有限公司 http://www.naco.com.cn

1：强制100Mbps良好连接状态该位用于诊断。 16.6 16.5 SPLED_CTL COLLED_CT 0,RW 0,RW 保留应用中强制为0 保留应用中强制为0 简化掉电控制使能该位用于使能自动简化掉电。 0=禁止自动精简掉电 1=使能自动精简掉电复位状态机当给该位写1，PHY的所有状态机将被复位。该位在复位完成后自清除。 MF前导抑制控制帧前导抑制控制位 1=MF前导抑制位开 0=MF前导抑制位关睡眠模式该位写1将造成PHY进入睡眠模式和使除了晶振和时钟产生电路外的所有电路掉电。当从睡眠模式中唤醒（该位写0），配置将变为睡眠之前的状态，但是状态机将被复位。远程循环输出控制当该位置1，接收的数据将循环输出到发送通道。该位用于错误位检测。 16.4 RPDCTR_EN 1,RW 16.3 SMRST 0,RW 16.2 MFPSC 1,RW 16.1 SLEEP 0,RW 16.0 RLOUT 0,RW 8.9 DAVICOM指定配置和状态寄存器（DSCSR）

DAVICOM Specified Configuration and Status Register (17) 位位名称默认描述 100M全双工操作模式自动协商完成后，结果将被写到该位。若该位为1，意味着操作1模式是100M全双工模式。软件可以通过读bit[15:12]来看经过自动协商后选择的是哪一种模式。当不是自动协商模式下该位非法。 17.15 100FDX 1,RO 34

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100M半双工操作模式自动协商完成后，结果将被写到该位。若该位为1，意味着操作1模式是100M全双工模式。软件可以通过读bit[15:12]来看经过自动协商后选择的是哪一种模式。当不是自动协商模式下该位非法。 10M全双工操作模式自动协商完成后，结果将被写到该位。若该位为1，意味着操作1模式是100M全双工模式。软件可以通过读bit[15:12]来看经过自动协商后选择的是哪一种模式。当不是自动协商模式下该位非法。 10M全双工操作模式自动协商完成后，结果将被写到该位。若该位为1，意味着操作1模式是100M全双工模式。软件可以通过读bit[15:12]来看经过自动协商后选择的是哪一种模式。当不是自动协商模式下该位非法。保留读0，忽略写 PHY地址bit 4:0 首先发送或接收的PHY地址位是地址的最高有效位（bit4）。一个连接到多种PHY实体的站管理实体必须知道每个PHY的适当的地址。自动协商监视位这些位只用于调试。自动协商状态将被写到这些位。 b3 0 0 17.3-17.0 ANMB[3:0] 0,RO 0 0 0 0 0 0 17.14 100HDX 1,RO 17.13 10FDX 1,RO 17.12 10HDX 1,RO 17.11-17.9 保留 0,RO 17.8-17.4 PHYADR[4:0] (PHYADR),RW b2 0 0 0 0 1 1 1 1 b1 0 0 1 1 0 0 1 1 b0 0 1 0 1 0 1 0 1 空闲状态能力匹配认证匹配认证匹配失败协调匹配协调匹配失败并行检测信号连接准备好并行检测信号连接准备好失败 35

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8.10 10BASE-T配置/状态（10BTCSR）

10BASE-T Configuration/Status (18) 位 18.15 位名称保留默认 0,RO 描述保留读0，忽略写；连接脉冲使能 1：连接脉冲的发送使能； 0：连接脉冲禁止，良好连接状态被强制；该位仅在10Mbps操作中有效；心跳使能 1：心跳功能使能； 0：心跳功能禁止；当DM9000A配置为全双工操作，该位被忽略（冲突/心跳功能在全双工模式下无效）静噪使能； 1：正常静噪 0：低静噪 Jabber使能当DM9000A在10BASE-T全双工或10BASE-T收发器回环模式下使能或禁止Jabber功能保留应用中强制为0；保留读0，忽略写；极性保存当该位置1，指示着10Mbps电缆线极性保存。该位由10BASE-T模块自动清除和置位。 18.14 LP_EN 1,RW 18.13 HBE 1,RW 18.12 SQUELCH 1,RW 18.11 JABEN 1,RW 18.10 保留 0,RW 0,RO 18.9-18.1 保留 18.0 POLR 0,RO 8.11掉电控制寄存器（PWDOR）

Power Down Control Register (19) 位 19.15-19.9 19.8 19.7 19.6 位名称保留 PD10DRV PD100DL PDchip 默认 0,RO 0,RW 0,RW 0,RW 描述保留读0，忽略写；生产厂家掉电控制测试生产厂家掉电控制测试生产厂家掉电控制测试 36

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19.5 19.4 19.3 19.2 19.1 19.0 PDcom PDaeq PDdrv PDedi PDedo PD10 0,RW 0,RW 0,RW 0,RW 0,RW 0,RW 生产厂家掉电控制测试生产厂家掉电控制测试生产厂家掉电控制测试生产厂家掉电控制测试生产厂家掉电控制测试生产厂家掉电控制测试 *当被选择时，掉电值将由寄存器20.0控制

8.12指定配置寄存器（SCR）

(Specified config) Register-20 位 20.15 20.14 20.13 20.12 20.11-20.8 位名称 TSTSE1 TSTSE2 FORCE_TXSD FORCE_FEF 保留默认 0,RW 0,RW 0,RW 0,RW 0,RO 描述厂家测试选择控制厂家测试选择控制强制信号检测 1：在100M中强制SD信号OK； 0：正常SD信号；厂家测试选择控制保留读0，忽略写； MDI/MDIX值的极性 1：MDIX模式 0：MDI模式自动协商回环 1：测试内部数字自动协商回环 0：正常 MDIX_CNTL强制值：当Mdix_down = 1, MDIX_CNTL值取决于该寄存器的值。 AUTO-MDIX关闭手动强制MDI/MDIX. 0：使能AUTO-MDIX 1：禁止AUTO-MDIX，MDIX_CNTL值取决于20.5 厂家测试选择控制厂家测试选择控制保留应用中强制为0 掉电控制值决定寄存器19每一位的值； 1：掉电 0：正常 20.7 MDIX_CNTL MDI/MDIX, RO 20.6 AutoNeg_lpbk 0,RW 20.5 Mdix_fix Value 0,RW 20.4 Mdix_down 0,RW 20.3 20.2 20.1 MonSel1 MonSel0 保留 0,RW 0,RW 0,RW 20.0 PD_value 0,RW 37

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9. 功能描述

9.1 主机接口（HI）

主机接口为ISA总线模式，有8个IO基址，分别为：300H、310H、320H、330H、340H、350H、360H、370H。这些地址可由strap引脚锁存或从eeprom加载。

只有两个地址端口经过主机接口，一个是INDEX端口，另一个时DATA端口。当引脚CMD=0时，主机接口作INDEX端口用，当引脚CMD=1时，主机接口作DATA端口用。INDEX端口的内容为DATA端口的寄存器地址。在访问任何寄存器之前，寄存器地址都必须保存在INDEX端口中。

9.2 直接内存访问控制（DMAC）

DM9000支持DMA方式简化对内部存储器的访问。在我们编程写好内部存储器地址后，就可以用一个读/写命令伪指令把当前数据加载到内部数据缓冲区，这样，内部存储器指定位置就可以被读/写命令寄存器访问。存储器地址将会自动增加，增加的大小与当前总线操作模式相同（比如：8-bit、16-bit或32-bit），接着下一个地址数据将会自动加载到内部数据缓冲区。要注意的是在连续突发式第一次访问的数据应该被忽略，因为，这个数据是最后一次读写命令的内容。

内部存储器空间大少16K字节。头3K字节单元用作发送包的缓冲区，其他13K字节用作接收包的缓冲区。所以在写存储器操作时，如果地址越界（即超出3K空间），在IMR寄存器bit-7置位的情况下，地址指针将会返回到存储器0地址处。同样，在读存储器操作时，如果地址越界（即超出16K空间），在IMR寄存器bit-7置位的情况下，地址指针将会返回到存储器0x0C00地址处。

9.3 数据包发送（PT）

有两个数据包，顺序命名为index1和index2，能同时存储在TX SRAM中。发送控制寄存器（02h）控制循环冗余校验码（CRC）和填充（pads）的插入，其状态分别记录在发送状态寄存器I（03H）和发送状态寄存器II（04H）中。

发送器的起始地址为0x00H，在软件或硬件复位后，默认的数据发送包为index1。首先，使用DMA端口将数据写入TX SRAM中，其次，在发送数据包长度寄存器（0fch/0fdh）中，把数据字节数写入字节计数寄存器。置位发送控制寄存器的bit-0位，则DM9000开始发送index1数据包。在index1数据包发送结束之前，数据发送包index2被移入TX SRAM中。在index1数据包发送结束后，将index2数据字节数写入字节计数寄存器中，然后，置位发送控制寄存器的bit-0位，则index2数据包开始发送。以此类推，后面的数据包都以此方式进行发送。

9.4 数据包接收（PR）

RX SRAM是一个环形数据结构。在软件或硬件复位后，RX SRAM的起始地址为

0X0C00。每个接收数据包都包含有CRC校验域，数据域，以及紧跟其后的4字节包头域。4字节包头格式为：01h、状态、BYTE_COUNT低、BYTE_COUNT高。请注意：每个接

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收包的起始地址处在适当的地址边界，这取决于当前总线操作模式（8-bit、16-bit）。

9.5 100Base-TX操作

发送器部分包含以下功能模块：

 4B5B编码器

 扰频器（Scrambler）  并—串转换

 NRZ码到NRZI码转换  NRZI码到MLT-3码转换  MLT-3驱动

9.5.1 4B5B编码器

4B5B编码器把MAC层生成的4-bit（4B）半字节数据转换成5-bit（5B）编码进行发送，请参考Table1。这种转换需要控制数据和包数据在编码中相结合。在数据包发送时，4B5B编码器首先用J/K编码对（11000 10001）取代MAC前导字节的头8bits数据，标记传送数据包的开始。随后，对数据包继续进行4B5B编码。当到达数据包的末尾且MAC层的发送使能信号消逝时，4B5B编码器插入T/R编码对（01101 00111）来指示数据包的结束。之后，4B5B编码器就持续插入IDLEs信号到发送数据流中，直到发送使能信号置位且下一个数据包被检测到。

DM9000A有一个取消4B5B编码转换的选项，以支持像100Mbps重发器那样不需要4B5B编码转换的应用。

9.5.2扰频器（Scrambler）

在100Base-TX操作中，扰频器是通过频谱能量在媒介连接器与双绞线电缆中的分布来控制电磁辐射（EMI）。通过扰频数据，电缆中的总能量就随机地分布在宽的频率范围。如果没有扰频器，电缆中的能量等级就会超出FCC的频率限制，该频率与反复的5B编码序列相关，就像持续发送的IDLE信号。从扰频器输出的信号通过逻辑异或（XOR）与NRZ 5B编码数据进行结合。结果是，在时钟频率下，带很强随机性的扰频数据流可以降低电磁辐射。

9.5.3 并--串转换

并—串转换器接收并行扰频的5B数据并将它转换为串行数据，然后将串行数据发送到NRZ到NRZI转换的模块中。

9.5.4 NRZ码到NRZI码转换

对于使用5类非屏蔽双绞线对电缆的100Base-TX的发送操作，在发送数据流完成扰频和串行后，必须进行NRZI编码来保持与TP-PMD标准相兼容。

9.5.5 NRZI码到MLT-3码转换

MLT-3码转换是通过将NRZI编码成交替定相逻辑1的二进制数据流来完成的。

9.5.6 MLT-3驱动

MLT-3转换器生成的二进制数据流被用于双绞线对的输出驱动。MLT-3转换器将这些数据流转换为电流源，然后，交变地驱动传输变压器的主线圈端，结果是产生一个最小的MLT-3

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信号。

9.5.7 4B5B编码

9.6 100Base-TX接收器

100Base-TX接收器包含一些功能模块，这些模块将125Mb/s的串行数据转换为同步4-bit半字数据。包含以下功能模块：

 信号检测

 数字自适应补偿  MLT-3到二进制解码

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     

时钟复原模块

NRZI到NRZ解码串－并转换扰频

编码组对齐 4B5B解码

9.6.1 信号检测

信号检测功能是为了满足ANSI XT12 TP-PMD 100Base-TX标准定义的电压门限与定时参数的说明。

9.6.2 自适应补偿

当传输数据在双绞线电缆上高速传输时，会产生频率衰减问题。在双绞线传输高速信号时，发送信号频率在基于扰频数据流随机性的正常工作期间，变化很大。这个信号衰减的变化是由频率变化引起的，必须进行补偿以保证接收数据的完整性。为了确保传输质量，当使用MLT-3编码时，信号补偿功能能适应各种电缆长度和类型，这些长度和类型是由具体安装环境确定的。对于一个给定执行方案的电缆长度的选择，要求合理的补偿，这个补偿不包含短距离、很少衰减电缆长度的情况。相反地，如果选择需要很少补偿的短的或中等长度的电缆将会引起在长电缆情况下的连续的欠补偿。因此，信号补偿和信号均衡必须被采用以确保接收到合适的信号，而这个信号跟电缆长度无关。

9.6.3 MLT-3到NRZI解码

DM9000A从数字自适应补偿处将MLT-3信息解码成NRZI数据。

9.6.4 时钟复原模块

时钟复原模块从MLT-3 to NRZI解码器处接收NRZI数据。时钟复原模块锁存数据流以及从中提取125MHz的参考时钟。这个时钟和数据将出现在从NRZI 到NRZ 的解码器中。

9.6.5 NRZI 到NRZ

对于采用5类非屏蔽双绞线电缆的100Base-TX，其发送数据要求采用NRZI编码以保持与TP-PMD标准相兼容。这个转换必须在接收终端被保存。NRZI to NRZ解码器从时钟复原模块接收NRZI数据流，并将其转换为NRZ数据流，NRZ数据流将出现在串－并的转换模块中。

9.6.6 串－并转换

串－并转换器从NRZI to NRZ解码器中接收串行数据并将其转换为并行数据，送到扰频器中。

9.6.7 扰频器

由于扰频器是在发送数据时用来控制电磁辐射的，所以，接收器也必须对接收到的数据进行扰频。扰频器从串－并转换器中接收扰频的并行数据流，去除数据扰频将数据送到编码组对齐模块中。

9.6.8 编码组对齐模块

编码组对齐模块从扰频器中接收非对齐的5B数据，并将其转换为对齐的5B编码组数

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据。编码组对齐发生在J/K码组被检测到之后，随后的数据将以固定边界进行对齐。

9.6.9 4B5B解码

4B5B解码功能可以看作一个查找列表，用于将接收到的5B码组解码成4B编码数据。当接收到一帧数据时，头25bits码组用于接收帧开始分隔符（J/K符号）。J/K符号对被两个半字节前导符代替。最后两个码组为帧结束分隔符（T/R符号），T/R符号对也是被两个半字节代替出现在MAC层上。

9.7 10Base-T操作

10Base-T发送器遵照IEEE 802.3u标准。当DM9000A工作在10Base-T模式时，采用曼切斯特编码（Manchester）。数据发送处理时，数据以半字节格式出现。先将其转换为串行的比特流，然后进行曼切斯特编码。当接收数据时，将接收到的比特流进行曼切斯特解码，然后转换为半字节格式。

9.8 冲突检测

对于半双工操作，当接收和发送通道同时工作时，将进行冲突检测。冲突检测功能在全双工模式时禁止。

9.9 载波检测

在半双工模式时，载波检测（CRS）在接收和发送期间都有效。而在全双工模式时，只在接收操作时有效。

9.10 自动协商

自动协商功能为两个连接设备提供信息交换和自动配置设备以使设备发挥出最佳性能。值得注意的是：自动协商并不是测试连接设备特性。自动协商功能为设备提供一种广告支持模式，这个模式支持远程设备连接、应答接收信号、支持普通模式操作和拒绝非共享模式的操作。在最多的普通操作模式下，它允许设备在两部分的终端建立连接。如果在两设备间存在多于一个普通模式，则根据预先定义好的优先级来选择一个操作模式。

自动协商功能可为设备提供并行检查功能，尽管该设备不支持自动协商功能。在并行检查期间，不产生配置交换信息，取而代之的是接收信号检查。如果发现一个接收设备支持的信号匹配协议，则设备会根据该协议建立连接。这允许设备不支持自动协商功能，但是要支持一个普通操作模式来建立连接。

9.11 省电模式

信号检测电路一直在检测传输介质上是否有电缆断开的信号。如果有，DM9000A则自动关闭电源进入省电模式，而不管操作模式是N-way模式或强制模式。当进入省电模式时，发送电路仍然以最小功率损耗来发送快速连接脉冲。如果从介质中检测到一个有效的信号，该信号可能为N-ways 快速连接脉冲，10Base-T普通连接脉冲，或是100Base-TX MLT3

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信号，则设备被唤醒进入普通操作模式。

可以写“0”到PHY Reg.16.4禁止省电模式。

9.11.1 掉电模式

PHY Reg.0.11设置为高电平进入掉电模式，该模式禁止所有发送和接收功能，访问PHY寄存器除外。

9.11.2 降低发送损耗模式

额外的降低发送损耗可以通过改变变压器TX端的转换比率为1.25：1，在BGRES与AGND引脚处接一个8.5KΩ电阻、将TXO+/TXO-上的上拉电阻由50Ω改为78Ω来实现。该配置可以而外降低20％的损耗。

10 DC与AC电器特性

10.1 最大绝对额定值

10.1.1 工作条件

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10.2 DC电器特性（VDD=3.3V）

10.3 AC电器特性与时序

10.3.1 TP接口

10.3.2 晶振/振荡时钟

南京电研电力自动化股份有限公司 http://www.naco.com.cn 10.3.3 I/O读时序

说明：（默认CLK周期为20ns）

1、当SD总线宽度为16-bit、系统地址为DATA端口（i.e.CMD为高）、INDEX端口为存储

器数据寄存器索引（ex.F0H,F2H,F6H,F8H）时，IO16有效。

10.3.4 I/O写时序

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说明：（默认CLK周期为20ns）

1、当SD总线宽度为16-bit、系统地址为DATA端口（i.e.CMD为高）、INDEX端口为存储

器数据寄存器索引（ex.F0H,F2H,F6H,F8H）时，IO16有效。

10.3.5 EEPROM接口时序

11应用说明

11.1网络接口信号接线

尽量的将变压器靠近RJ-45连接器放置，尽量将所有50Ω电阻靠近DM9000A的RXI+/-与TXI+/-引脚放置。RXI+/-与TXO+/-到变压器的布线（以尽量靠近的差分线对形式）应直接与变压器连接，应尽量避免使用过孔。在RJ-45与变压器之间以及变压器与DM9000A之间，除了布RXI+/-与TXO+/-信号线之外，不要布置任何其他的信号线。在RJ-45与变压器之间的区域内不要放置电源和地平面（参考图11－4与11－5）。使机架地远离所有信号线。对于RJ-45连接器与所有没使用的引脚都必须通过一个电阻和2KV的旁路电容连接到机架地。

Band Gap电阻应尽量靠近引脚1与引脚48放置（参考图11-1与11-2）。不能在Band Gap电阻附件放置任何高频信号线。

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11.2 10Base-T/100Base-TX自动MDIX应用

11.3 10Base-T/100Base-TX无自动MDIX变压器应用

11.4电源退偶电容

Davicom半导体公司建议在DM9000A所有电源引脚焊盘附件放置去偶电容，越靠近引脚越好（最佳放置距离<3mm）。推荐的电容值为0.1uf或0.01uf，根据布局需要选择。

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11.5地平面布局

Davicom半导体公司建议使用单一的地平面来降低EMI。地平面分割会增加EMI，以致网络接口卡不符合FCC通信规则（part15）。图11-4显示了推荐的地平面布局原理图。

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图11-4 地平面布局

11.6电源平面分割

电源平面应按照图11-5所示分割。

图11-5 电源平面分割

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11.7铁氧体磁珠选择指导

变压器需求请参考表2。这些变压器，都适用于各个厂商的铁氧体磁珠，用户应该在适用前测试所有的磁珠。表2列出的所有变压器都是电气相当的，但是，不都是引脚到引脚相当。

11.8晶振选择指导

晶振可以用于产生25MHz的参考时钟信号，晶振必须为基频类型、连续振荡。晶振连接到X1与X2引脚上，并在每个晶振引脚上并联一个22pf的电容到地平面（参考图11-6）。

12封装信息

LQFP 48L (F.P.2mm) 外形尺寸（单位为：inches/mm）

南京电研电力自动化股份有限公司 http://www.naco.com.cn

13订购信息

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